用于编译C/C++的一个通用Makefile文件
Ideal:在Linux C下,每当编写一些小程序或较大的项目时,都要进行重复的gcc编译命令,是否可以编写一个通用的Makefile文件,通过执行make命令实现编译(好像正是设计Makefile的意图之一,呵呵),了解相关Makefile编写规则后,初步实现了一个较为简单的Makefile文件,往后遇到实际的问题,将不断完善Makefile的功能。
这个Makefile主要针对GCC和GNU Make环境编写,其它版本的编译器和Make不能保证正常工作。
如果您发现本文中的错误,或者对本文有什么感想和意见,可以通过 jikhkhong AT gmail DOT com邮箱与作者联系。
以下是具体的实现过程:
实现的功能:
- make——编译和连接程序
- make objs——编译程序,生成目标文件
- make clean——清除编译产生的目标文件(*.o)和依赖文件(*.d)
- make cleanall——清除目标文件(*.o)、依赖文件(*.d)和可执行文件(*.exe)
- make rebuild——重新编译连接程序,相当于make clean && make
Makefile源代码
- # Gneric C/C++ Makefile
- ####################################################
- PROGRAM :=
- SRCDIRS :=
- SRCEXTS :=
- CPPFLAGS :=
- CFLAGS :=
- CFLAGS +=
- CXXFLAGS :=
- CXXFLAGS +=
- LDFLAGS :=
- LDFLAGS +=
- SHELL = /bin/sh
- SOURCES = $(foreach d,$(SRCDIRS),$(wildcard $(addprefix $(d)/*,$(SRCEXTS))))
- OBJS = $(foreach x,$(SRCEXTS),\
- $(patsubst %$(x),%.o,$(filter %$(x),$(SOURCES))))
- DEPS = $(patsubst %.o,%.d,$(OBJS))
- .PHONY: all objs clean cleanall rebuild
- all : $(PROGRAM)
- %.d : %.c
- @$(CC) -MM -MD $(CFLAGS) {1}lt;
- %.d : %.C
- @$(CC) -MM -MD $(CXXFLAGS) {1}lt;
- objs : $(OBJS)
- %.o : %.c
- $(CC) -c $(CPPFLAGS) $(CFLAGS) {1}lt;
- %.o : %.cpp
- $(CXX) -c $(CPPFLAGS) $(CXXFLAGS) {1}lt;
- $(PROGRAM) : $(OBJS)
- ifeq ($(strip $(SRCEXTS)),.c)
- $(CC) -o $(PROGRAM) $(OBJS) $(LDFLAGS)
- else
- $(CXX) -o $(PROGRAM) $(OBJS) $(LDFLAGS)
- endif
- -include $(DEPS)
- rebuild: clean call
- clean:
- @$(RM) *.o *.d
- cleanall: clean
- @$(RM) $(PROGRAM) $(PROGRAM).exe
相关推荐
xushxbigbear微信 2020-05-16
jeonkc 2020-04-19
mikesno 2020-02-23
hazing 2020-02-22
yoshubom 2020-07-18
Plant 2020-06-07
wanggongzhen 2020-05-28
hazing 2020-05-01
hongsheyoumo 2020-05-01
choupiaoyi 2020-01-23
83096129 2020-01-17
Joymine 2020-01-03
christinzhm 2010-09-13
downtown 2010-09-13
hbcbgcx 2011-04-07
hbcbgcx 2011-03-24
Will0 2011-03-15
ITlover00 2011-03-13
zhonglinzhang 2011-02-28